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    重庆时时彩稳赚计划: 一种基于FPGA的系统对时装置及对时方法.pdf

    摘要
    申请专利号:

    重庆时时彩单双窍门 www.4mum.com.cn CN201610257128.5

    申请日:

    2016.04.22

    公开号:

    CN105955398A

    公开日:

    2016.09.21

    当前法律状态:

    实审

    有效性:

    审中

    法律详情: 授权|||著录事项变更IPC(主分类):G06F 1/12变更事项:申请人变更前:南京国电南自美卓控制系统有限公司变更后:南京国电南自维美德自动化有限公司变更事项:地址变更前:210032 江苏省南京市浦口高新开发区星火路8号变更后:210032 江苏省南京市浦口高新区惠达路9号|||实质审查的生效IPC(主分类):G06F 1/12申请日:20160422|||公开
    IPC分类号: G06F1/12; G06F1/14 主分类号: G06F1/12
    申请人: 南京国电南自美卓控制系统有限公司
    发明人: 李伟; 黄作兵; 杨淑萍; 赵永; 黄蕾
    地址: 210032 江苏省南京市浦口高新开发区星火路8号
    优先权:
    专利代理机构: 南京纵横知识产权代理有限公司 32224 代理人: 董建林
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201610257128.5

    授权公告号:

    |||||||||

    法律状态公告日:

    2019.05.17|||2017.03.29|||2016.10.19|||2016.09.21

    法律状态类型:

    授权|||著录事项变更|||实质审查的生效|||公开

    摘要

    本发明公开了一种基于FPGA的系统对时装置及对时方法,包括主站电路??楹投喔龃诱镜缏纺??;主站电路??楹投喔龃诱镜缏纺?橥ü鼴LVDS总线电连接;主站电路??榘ㄒ来嗡沉腃PU芯片、GPMC接口和第一FPGA芯片,第一FPGA芯片包括顺次连接的时间设置寄存器、内部时钟???、IRIG?B编码??楹偷谝籅LVDS编解码???,IRIG?B编码??榈氖涑龆嘶褂氲谝籆PU芯片的输入端连接;多个从站电路??榫ǖ诙﨔PGA芯片和第二CPU芯片,第二FPGA芯片包括第二BLVDS编解码???。本发明根据IRIG?B的时序,利用FPGA编写IRIG?B发送???,按照IRIG?B编码格式发送信号,利用BLVDS总线,将编码发送至各个对时卡件,解决各个卡件对时的问题。

    权利要求书

    1.一种基于FPGA的系统对时装置,其特征在于:包括主站电路??楹投喔龃诱镜缏纺?br />块;所述主站电路??楹投喔龃诱镜缏纺?橥ü鼴LVDS总线电连接;所述主站电路模
    块包括依次顺连的第一CPU芯片、GPMC接口和第一FPGA芯片,所述第一FPGA芯
    片包括顺次连接的时间设置寄存器、内部时钟???、IRIG-B编码??楹偷谝籅LVDS
    编解码???,所述IRIG-B编码??榈氖涑龆嘶褂氲谝籆PU芯片的输入端连接,用于
    第一CPU芯片进行IRIG-B信号解码;所述多个从站电路??榫ㄒ来嗡辰拥牡诙?br />FPGA芯片和第二CPU芯片,第二FPGA芯片包括第二BLVDS编解码???,第二CPU
    芯片用于进行IRIG-B信号解码。
    2.根据权利要求1所述的一种基于FPGA的系统对时装置,其特征在于:所述IRIG-B编
    码??榈氖涑龆送ü齀RIG-B信号线与第一CPU芯片的输入端连接。
    3.根据权利要求1所述的一种基于FPGA的系统对时装置,其特征在于:所述IRIG-B编
    码??橥毕虻谝籅LVDS编解码??楹偷谝籆PU芯片发送数据。
    4.根据权利要求1所述的一种基于FPGA的系统对时装置,其特征在于:所述第二BLVDS
    编解码??橛氲诙﨏PU芯片通过IRIG-B信号线连接。
    5.根据权利要求1所述的一种基于FPGA的系统对时装置的对时方法,其特征在于,包
    括以下步骤:
    S1:通过第一CPU芯片及GPMC接口向第一FPGA芯片发送时间数据和对时指令数据;
    S2:第一FPGA芯片中,根据接收到的时间数据和对时指令数据设置时间设置寄存器和
    内部时钟???,IRIG-B编码??楦菽诓渴敝幽?榈脑诵惺奔?,进行IRIG-B编码生成
    B码信号,并将B码信号传递到第一BLVDS编解码???,然后将B码信号编码为BLVDS
    总线信号发送到BLVDS总线上,同时IRIG-B编码??榉⑺拖嗤腂码信号到第一CPU
    芯片中;
    S3:从站电路??橹械牡诙﨔PGA芯片中的第二BLVDS编解码??榻邮盏降腂LVDS
    总线信号转换为逻辑B码信号,最后通过IRIG-B信号线发送到的第二CPU芯片中。
    6.根据权利要求5所述的一种基于FPGA的系统对时装置的对时方法,其特征在于:所
    述步骤S1中还包括:装置上电时,通过第一CPU芯片的初始化函数将第一CPU芯片自
    身运行时间数据通过GPMC接口传送到第一FPGA芯片。
    7.根据权利要求5所述的一种基于FPGA的系统对时装置的对时方法,其特征在于:所
    述步骤S2中,时间设置寄存器接收并存储第一CPU芯片发送的时间数据,内部时钟模
    块根据时间设置寄存器中的时间值进行初始化,作为内部时钟源运行,并根据对时指
    令设置内部时钟源开始对时标志。
    8.根据权利要求5所述的一种基于FPGA的系统对时装置的对时方法,其特征在于:所
    述第一CPU芯片和第二CPU芯片均能够对接收到的B码信号进行解码。

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    一种 基于 FPGA 系统 时装 时方
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