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    重庆时时彩二码杀号: 用于核心的全局低功率捕获方案.pdf

    摘要
    申请专利号:

    重庆时时彩单双窍门 www.4mum.com.cn CN201310741793.8

    申请日:

    2013.12.27

    公开号:

    CN103913696A

    公开日:

    2014.07.09

    当前法律状态:

    撤回

    有效性:

    无权

    法律详情: 发明专利申请公布后的视为撤回IPC(主分类):G01R 31/28申请公布日:20140709|||实质审查的生效IPC(主分类):G01R 31/28申请日:20131227|||公开
    IPC分类号: G01R31/28 主分类号: G01R31/28
    申请人: 辉达公司
    发明人: 萨蒂亚·普瓦达; 米林得·索纳瓦乐; 阿米特·桑加尼; 阿奴伯哈·辛哈; 维沙尔·阿加瓦尔
    地址: 美国加利福尼亚州
    优先权: 2012.12.28 US 13/730,690
    专利代理机构: 北京市磐华律师事务所 11336 代理人: 董巍;谢栒
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201310741793.8

    授权公告号:

    ||||||

    法律状态公告日:

    2017.03.08|||2014.08.06|||2014.07.09

    法律状态类型:

    发明专利申请公布后的视为撤回|||实质审查的生效|||公开

    摘要

    本发明提供了用于核心的全局低功率捕获方案。提供了用于测试集成电路的方法,以缓解扫描捕获模式期间的峰值功率问题。方法包括,对用于集成电路上的多个核心和高速缓存的每一个的第一时间窗的各自的持续时间进行编程。方法进一步包括对用于多个核心和高速缓存的每一个的第一时间窗期间的第一时钟信号的脉冲的数目进行计数。随后,方法包括,通过在各自的第二时间窗期间,生成用于多个核心和高速缓存的每一个的第二时钟信号的脉冲,来将捕获脉冲交错到多个核心和高速缓存,其中所生成的脉冲的数目基于为多个核心和高速缓存的每一个所计数的各自的第一时钟信号脉冲的数目。

    权利要求书

    权利要求书
    1.  一种用于测试集成电路的方法,所述方法包括:
    对用于所述集成电路上的多个核心以及高速缓存中的每一个的第一时间窗的各自的持续时间进行编程;
    对用于所述多个核心和所述高速缓存中的每一个的所述第一时间窗期间的第一时钟信号的脉冲的数目进行计数;以及
    通过在各自的第二时间窗期间生成用于所述多个核心和所述高速缓存中的每一个的第二时钟信号的脉冲,将捕获脉冲交错到所述多个核心和所述高速缓存,其中所生成的脉冲的数目基于为所述多个核心和所述高速缓存中的每一个所计数的第一时钟信号脉冲的相应数目。

    2.  根据权利要求1所述的方法,进一步包括,在单独的ATPG运行中将所述多个核心中的每一个与所述高速缓存进行脉冲、同时交错剩余核心,以获得对相应核心和所述高速缓存之间的组合路径的覆盖。

    3.  根据权利要求2所述的方法,进一步包括遮蔽所述高速缓存和所述剩余核心之间的路径。

    4.  根据权利要求1所述的方法,进一步包括,通过对所述多个核心和所述高速缓存的第一子集一起进行脉冲、同时交错剩余核心,以动态地获得在单个ATPG运行期间对所述集成电路上的实质上所有组合路径的覆盖。

    5.  根据权利要求4所述的方法,其中,动态地确定所述第一子集中所要包括的???,以及其中所述??榭梢园ê诵暮退龈咚倩捍?。

    6.  根据权利要求5所述的方法,其中当对所述第一子集中的所述核心和所述高速缓存一起进行脉冲时,将所述第一子集中的所述??楹退鍪S嗪诵闹涞淖楹下肪墩诒?。

    7.  根据权利要求1所述的方法,其中所述集成电路从包括图形处理器和中央处理器的组中选择。

    8.  根据权利要求1所述的方法,其中所述第一时间窗的所述各自的持续时间是用户可编程的。

    9.  一种用于测试集成电路的方法,所述方法包括:
    对用于所述集成电路上的多个??橹械拿恳桓瞿?榈牡谝皇奔浯暗母髯缘某中奔浣斜喑?,其中所述??榘ǘ喔龊诵囊约案咚倩捍?;
    对用于所述多个??橹械拿恳桓瞿?榈乃龅谝皇奔浯捌诩涞牡谝皇敝有藕诺穆龀宓氖拷屑剖?;以及
    通过在各自的第二时间窗期间,生成用于所述多个核心和所述高速缓存中的每一个的第二时钟信号的脉冲,来将捕获脉冲动态交错到??榈牡谝蛔蛹?,其中所生成的脉冲的数目基于为所述多个??橹械拿恳桓瞿?樗剖牡谝皇敝有藕怕龀宓南嘤κ?。

    10.  根据权利要求9所述的方法,其中??榈牡诙蛹苯邮账龅诙敝有藕诺穆龀?,其中所述??榈牡诙蛹话ㄔ谒龅谝蛔蛹械哪??。

    11.  根据权利要求10所述的方法,其中所述第二子集中的??榈氖康闹凳强杀喑痰?。

    12.  一种用于测试集成电路的系统,所述系统包括:
    包括测试器处理器的计算机系统,其中所述测试器处理器通信地耦连到集成电路,其中所述集成电路包括:
    多个核心以及高速缓存;
    I/O端口,可操作为对用于所述集成电路上的所述多个核心和所述高速缓存中的每一个的第一时间窗的各自的持续时间进行编程;以及
    多个快速时钟生成???,配置为:
    对用于所述多个核心和所述高速缓存中的每一个的所述第一时间窗期间的第一时钟信号的脉冲的数目进行计数;以及
    通过在各自的第二时间窗期间生成用于所述多个核心和所述高速缓存中的每一个的第二时钟信号的脉冲,来将捕获脉冲交错到所述多个核心和所述高速缓存,其中所生成的脉冲的数目基于为所述多个核心和所述高速缓存中的每一个所计数的第一时钟信号脉冲的相应数目。

    13.  根据权利要求12所述的系统,其中所述多个快速时钟生成??榻徊脚渲梦?,在单独的ATGP运行期间将所述多个核心中的每一个与所述高速缓存一起进行脉冲、同时交错剩余核心,以获得对相应核心和所述高速缓存之间的组合路径的覆盖。

    14.  根据权利要求13所述的系统,其中所述多个快速时钟生成??榻徊脚渲梦?,遮蔽所述高速缓存和所述剩余核心之间的路径。

    15.  根据权利要求12所述的系统,进一步包括动态捕获时钟交错???,其配置为通过对所述多个核心和高速缓存的第一子集一起进行脉冲、同时交错剩余核心,来动态获得单个ATPG运行期间对所述集成电路上的实质上所有的组合路径的覆盖。

    16.  根据权利要求15所述的系统,其中由所述动态捕获时钟交错??槎厝范ㄋ龅谝蛔蛹兴ǖ母咚倩捍婧投喔龊诵?。

    17.  根据权利要求12所述的系统,其中所述I/O端口是JTAG端口,其可操作为由用户编程。

    18.  根据权利要求12所述的系统,其中所述集成电路从包括图形处理器和中央处理器的组中选择。

    19.  根据权利要求12所述的系统,其中所生成的捕获脉冲的数目能够通过变化用于所述多个核心和所述高速缓存中的每一个的所述第一时间窗的各自的持续时间来改变。

    关 键 词:
    用于 核心 全局 功率 捕获 方案
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