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    重庆时时彩手机验证: 一种栅极驱动电路及显示器.pdf

    摘要
    申请专利号:

    重庆时时彩单双窍门 www.4mum.com.cn CN201310754900.0

    申请日:

    2013.12.31

    公开号:

    CN103928002A

    公开日:

    2014.07.16

    当前法律状态:

    授权

    有效性:

    有权

    法律详情: 授权|||实质审查的生效IPC(主分类):G09G 3/36申请日:20131231|||公开
    IPC分类号: G09G3/36 主分类号: G09G3/36
    申请人: 厦门天马微电子有限公司; 天马微电子股份有限公司
    发明人: 黄强灿
    地址: 361101 福建省厦门市火炬高新区翔安产业区翔安西路6999号
    优先权:
    专利代理机构: 北京品源专利代理有限公司 11332 代理人: 胡彬
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201310754900.0

    授权公告号:

    ||||||

    法律状态公告日:

    2016.06.15|||2014.08.13|||2014.07.16

    法律状态类型:

    授权|||实质审查的生效|||公开

    摘要

    本发明公开了一种栅极驱动电路及显示器,所述栅极驱动电路包括多个移位寄存器单元,一逻辑电路,用于接收第一时钟信号、第二时钟信号、第三时钟信号和第四时钟信号,并输出逻辑脉冲信号,所述逻辑脉冲信号用于驱动多个所述移位寄存器单元和多个使能电路;所述多个使能电路,与所述多个移位寄存器单元一对一连接,用于接收所述移位寄存器单元输出的第一脉冲信号和所述逻辑电路输出的所述逻辑脉冲信号,并输出多个第二脉冲信号,所述多个第二脉冲信号用于驱动多条栅线,其中,每个所述使能电路输出两个所述第二脉冲信号,用于驱动两条栅线。本发明使一个移位寄存器可同时控制两条栅线,减少使用的移位寄存器的个数,从而减少布线空间,实现面板窄边框化。

    权利要求书

    权利要求书
    1.  一种栅极驱动电路,包括多个移位寄存器单元,其特征在于,还包括:
    一逻辑电路,用于接收第一时钟信号、第二时钟信号、第三时钟信号和第四时钟信号,并输出逻辑脉冲信号,所述逻辑脉冲信号用于驱动所述多个移位寄存器单元和多个使能电路;
    所述多个使能电路,与所述多个移位寄存器单元一对一连接,用于接收所述移位寄存器单元输出的第一脉冲信号和所述逻辑电路输出的所述逻辑脉冲信号,并输出多个第二脉冲信号,所述多个第二脉冲信号用于驱动多条栅线,其中,每个所述使能电路输出两个所述第二脉冲信号,用于驱动两条栅线。

    2.  根据权利要求1所述的栅极驱动电路,其特征在于,同一使能电路输出的所述第二脉冲信号的脉冲持续时间相等,且所述第二脉冲信号的高电平持续时间不相重叠。

    3.  根据权利要求1所述的栅极驱动电路,其特征在于,所述多个移位寄存器单元包括从第1级移位寄存器单元至第2*N-1级移位寄存器单元依次级联的第一侧N级移位寄存器单元,从第2级移位寄存器单元至第2*N级移位寄存器单元依次级联的与第一侧相对的第二侧N级移位寄存器单元,所述N为大于1的整数。

    4.  根据权利要求3所述的栅极驱动电路,其特征在于,所述逻辑电路包括:
    第一逻辑电路,用于接收第一时钟信号和第四时钟信号,并输出第一逻辑脉冲信号,所述第一逻辑脉冲信号用于驱动所述第一侧N级移位寄存器单元的奇数行移位寄存器单元;
    第二逻辑电路,用于接收第一时钟信号和第二时钟信号,并输出第二逻辑脉冲信号,所述第二逻辑脉冲信号用于驱动所述第二侧N级移位寄存器单元的 奇数行移位寄存器单元;
    第三逻辑电路,用于接收第二时钟信号和第三时钟信号,并输出第三逻辑脉冲信号,所述第三逻辑脉冲信号用于驱动所述第一侧N级移位寄存器单元的偶数行移位寄存器单元;
    第四逻辑电路,用于接收第三时钟信号和第四时钟信号,并输出第四逻辑脉冲信号,所述第四逻辑脉冲信号用于驱动所述第二侧N级移位寄存器单元的偶数行移位寄存器单元;
    第五逻辑电路,用于接收第一时钟信号、第二时钟信号、第三时钟信号和第四时钟信号,并输出第五逻辑脉冲信号,所述第五逻辑脉冲信号用于驱动所述多个使能电路。

    5.  根据权利要求4所述的栅极驱动电路,其特征在于,所述第一逻辑脉冲信号经过第一反相器输出第一反相逻辑脉冲信号,所述第一反相逻辑脉冲信号用于驱动与所述第一侧N级移位寄存器单元的偶数行移位寄存器单元相连的使能电路;所述第二逻辑脉冲信号经过第二反相器输出第二反相逻辑脉冲信号,所述第二反相逻辑脉冲信号用于驱动与所述第二侧N级移位寄存器单元的偶数行移位寄存器单元相连的使能电路;所述第三逻辑脉冲信号经过第三反相器输出第三反相逻辑脉冲信号,所述第三反相逻辑脉冲信号用于驱动与所述第一侧N级移位寄存器单元的奇数行移位寄存器单元相连的使能电路;所述第四逻辑脉冲信号经过第四反相器输出第四反相逻辑脉冲信号,所述第四反相逻辑脉冲信号用于驱动与所述第二侧N级移位寄存器单元的奇数行移位寄存器单元相连的使能电路。

    6.  根据权利要求5所述的栅极驱动电路,其特征在于,所述使能电路包括 第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管、第五反相器和第六反相器;
    其中,所述第一薄膜晶体管的源极通过所述第五反相器与所述移位寄存器单元的输出端相连,漏极与所述第三薄膜晶体管、所述第二薄膜晶体管、所述第五薄膜晶体管的源极相连;
    所述第二薄膜晶体管的源极接收高电平信号,漏极与所述第一薄膜晶体管的漏极相连;
    当所述使能电路与所述第一侧N级移位寄存器单元奇数行移位寄存器单元相连时,所述第一薄膜晶体管和所述第二薄膜晶体管的栅极接收所述第一反相逻辑脉冲信号,当所述使能电路与所述第二侧N级移位寄存器单元的奇数行移位寄存器单元相连时,所述第一薄膜晶体管和所述第二薄膜晶体管的栅极接收所述第二反相逻辑脉冲信号,当所述使能电路与所述第一侧N级移位寄存器单元的偶数行移位寄存器单元相连时,所述第一薄膜晶体管和所述第二薄膜晶体管的栅极接收所述第三反相逻辑脉冲信号,当所述使能电路与所述第二侧N级移位寄存器单元的偶数行移位寄存器单元相连时,所述第一薄膜晶体管和所述第二薄膜晶体管的栅极接收所述第四反相逻辑脉冲信号;
    所述第三薄膜晶体管的源极与所述第一薄膜晶体管的漏极相连,漏极与所述使能电路中的两条输出线中的一条相连,栅极接收所述第五逻辑脉冲信号;
    所述第四薄膜晶体管的源极接收高电平信号,漏极与所述使能电路中的两条输出线中的一条相连,栅极通过所述第六反相器接收所述第五逻辑脉冲信号;
    所述第五薄膜晶体管的源极与所述第一薄膜晶体管的漏极相连,漏极与所述使能电路中的两条输出线中的另一条相连,栅极接收所述第五逻辑脉冲信号;
    所述第六薄膜晶体管的源极接收高电平信号,漏极与所述使能电路中的两条输出线中的另一条相连,栅极接收所述第五逻辑脉冲信号。

    7.  根据权利要求3-6中任一项所述的栅极驱动电路,其特征在于,第1级和第2级移位寄存器单元的输入端接收起始移位信号,从第1级移位寄存器单元至第2*N-2级任一级所述移位寄存器单元的输出端连接下一级移位寄存器单元的输入端,所述N为大于1的整数。

    8.  一种显示器,包括:
    显示区域,包括用于显示图像的多个像素;
    栅极驱动电路,用于将扫描信号送至所述显示区域;
    数据驱动电路,用于将数据信号送至所述显示区域;
    其中,所述栅极驱动电路为如权利要求1-7中任一项所述的栅极驱动电路。

    关 键 词:
    一种 栅极 驱动 电路 显示器
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