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    重庆时时彩分析走势图: 一种像素补偿电路及显示器.pdf

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    一种 像素 补偿 电路 显示器
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    摘要
    申请专利号:

    CN201310270876.3

    申请日:

    2013.06.28

    公开号:

    CN103927969A

    公开日:

    2014.07.16

    当前法律状态:

    授权

    有效性:

    有权

    法律详情: 专利权的转移IPC(主分类):G09G 3/32登记生效日:20170926变更事项:专利权人变更前权利人:天马微电子股份有限公司变更后权利人:广东聚华印刷显示技术有限公司变更事项:地址变更前权利人:518052 广东省深圳市福田区深南中路航都大厦22层南变更后权利人:510032 广东省广州市广州中新广州知识城凤凰三路17号自编五栋388|||专利权的转移 IPC(主分类):G09G 3/32登记生效日:20170718变更事项:专利权人变更前权利人:上海天马微电子有限公司变更后权利人:天马微电子股份有限公司变更事项:地址变更前权利人:201201 上海市浦东新区汇庆路889号变更后权利人:518052 广东省深圳市福田区深南中路航都大厦22层南变更事项:共同专利权人变更前权利人:天马微电子股份有限公司|||授权|||实质审查的生效IPC(主分类):G09G 3/32申请日:20130628|||公开
    IPC分类号: G09G3/32 主分类号: G09G3/32
    申请人: 上海天马微电子有限公司; 天马微电子股份有限公司
    发明人: 翟应腾; 吴勇
    地址: 201201 上海市浦东新区汇庆路889号
    优先权:
    专利代理机构: 北京同达信恒知识产权代理有限公司 11291 代理人: 刘松
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    法律状态
    申请(专利)号:

    CN201310270876.3

    授权公告号:

    ||||||||||||

    法律状态公告日:

    2017.10.20|||2017.08.04|||2016.06.22|||2014.08.13|||2014.07.16

    法律状态类型:

    专利申请权、专利权的转移|||专利申请权、专利权的转移|||授权|||实质审查的生效|||公开

    摘要

    本发明公开了一种像素补偿电路及显示器,用以补偿像素中NMOS驱动管的阈值漂移。所述像素补偿电路包括:第一开关单元、第二开关单元、第三开关单元、第四开关单元、第五开关单元、第六开关单元、发光器件和电容;其中,第一开关单元、第二开关单元、第三开关单元、第四开关单元、第五开关单元、第六开关单元均包括三个连接端。本发明提供的像素补偿电路对工艺要求较低,且较少的输入信号可以大大简化平板设计,提高显示器每英寸所拥有的像素数目,可以准确输出与进屏信号相关的电流,从而提高实际显示画面色彩的均一性,确保不出现显示异常。

    权利要求书

    权利要求书
    1.  一种像素补偿电路,其特征在于,该电路包括:第一开关单元、第二开关单元、第三开关单元、第四开关单元、第五开关单元、第六开关单元、发光器件和电容;第一开关单元、第二开关单元、第三开关单元、第四开关单元、第五开关单元、第六开关单元均包括三个连接端,其中,
    第一开关单元的第一连接端连接在第二开关单元和第三开关单元之间,第二连接端连接在电容和第四开关单元之间,第三连接端与高电平输入节点相连;
    第二开关单元的第一连接端与第一扫描信号输入节点相连,第二连接端与高电平输入节点相连,第三连接端与第三开关单元相连;
    第三开关单元的第一连接端与第二扫描信号输入节点相连,第二连接端与第二开关单元相连,第三连接端连接在电容和第五开关单元之间;
    第四开关单元的第一连接端与第三扫描信号输入节点相连,第二连接端与低电平输入节点相连,第三连接端连接在第一开关单元和第六开关单元之间;
    第五开关单元的第一连接端与第一扫描信号输入节点相连,第二连接端与数据信号输入节点相连,第三连接端与电容相连;
    第六开关单元的第一连接端与第二扫描信号输入节点相连,第二连接端与发光器件相连,第三连接端连接在电容和第四开关单元之间;
    发光器件连接在接地点与第六开关单元之间;
    电容连接在第四开关单元和第五开关单元之间。

    2.  根据权利要求1所述的电路,其特征在于,所述第一开关单元为第一薄膜晶体管,第二开关单元为第二薄膜晶体管、第三开关单元为第三薄膜晶体管、第四开关单元为第四薄膜晶体管、第五开关单元为第五薄膜晶体管、第六开关单元为第六薄膜晶体管。

    3.  根据权利要求1或2所述的电路,其特征在于,
    第一薄膜晶体管作为驱动管,其栅极与驱动管栅极节点相连,其另外两极 分别与驱动管源极节点和高电平输入节点相连;
    第二薄膜晶体管的栅极与第一扫描信号输入节点相连,其另外两极分别与驱动管栅极节点和高电平输入节点相连;
    第三薄膜晶体管的栅极与第二扫描信号输入节点相连,其另外两极分别与驱动管栅极节点和信号供给节点相连;
    第四薄膜晶体管的栅极与第三扫描信号输入节点相连,其另外两极分别与驱动管源极节点和低电平输入节点相连;
    第五薄膜晶体管的栅极与第一扫描信号输入节点相连,其另外两极分别与数据信号输入节点和信号供给节点相连;
    第六薄膜晶体管的栅极与第二扫描信号输入节点相连,其另外两极分别与驱动管源极节点和输出节点相连;
    发光器件连接在接地点与输出节点之间;
    电容连接在驱动管源极节点和信号供给节点之间。

    4.  根据权利要求1所述的电路,其特征在于,所述接地点和所述低电平输入节点相连。

    5.  根据权利要求2所述的电路,其特征在于,所有所述薄膜晶体管均为N型薄膜晶体管。

    6.  根据权利要求1所述的电路,其特征在于,所述发光器件为发光二极管或量子点发光层。

    7.  根据权利要求6所述的电路,其特征在于,当所述发光器件为发光二极管时,所述发光二极管的阴极与接地点相连,阳极与输出节点相连。

    8.  根据权利要求6或7所述的电路,其特征在于,所述发光二极管为量子点发光二极管QLED或有机发光二极管OLED。

    9.  根据权利要求3所述的电路,其特征在于,所述第一薄膜晶体管的漏级与高电平输入节点相连,源极与驱动管源极节点相连。

    10.  一种显示器,其特征在于,该显示器包括权利要求1-9任一权项所述 的电路。

    说明书

    说明书一种像素补偿电路及显示器
    技术领域
    本发明涉及发光二极管(Light Emitting Diode,LED)发光显示及驱动技术领域,尤其涉及一种像素补偿电路驱动方法及显示器装置。
    背景技术
    现有像素补偿电路采用N型金属氧化物半导体晶体管(Negative channel-Metal-Oxide-Semiconductor,NMOS管)作为开关器件。如图1所示,在数据写入与补偿阶段(阶段II)时,第一扫描信号(Gate1,G1)打开,输入数据信号(DATA),使得存储电容C两端电压分别为V_Data(信号输入极10电压)和V0-V_th(驱动管DrTr的源极12阈值电压)。在发光阶段(阶段III)时,G1关闭第二扫描信号(Gate2,G2)打开后,通过存储电容C耦合驱动管DrTr的栅极11和源极12的电压,锁定驱动管DrTr的栅源电压差为(V_Data-V0+V_th),从而同时补偿了阈值电压(V_th)漂移。
    而该现有技术存在一些问题,首先在补偿阶段II像素补偿电路需要两个反相扫描信号——第二扫描信号G2和第三扫描信号(Gate3,G3),因此需要多加两个时钟反相器,这为周边电路的设计带来了极大的困难。其次,在像素发光时,驱动管DrTr源极电压值为不定值。当DrTr源极电压在第三扫描信号G3关闭时受扰动,使驱动管DrTr源极电压值大于V0-V_Data,由于薄膜晶体管自身的特性,驱动管DrTr源极电压不可能再回落至所预计的V0-V_Data,因此如果在电路补偿阶段,驱动管DrTr源级电压受扰动,电路将无法按正确的方式对阈值漂移进行补偿,其中,所谓阈值漂移,即当薄膜晶体管处于长期打开的状态下,其阈值电压会发生变化。
    发明内容
    本发明实施例提供了一种像素补偿电路及显示器,用以补偿NMOS驱动管的阈值漂移,以及锁定像素补偿电路中NMOS驱动管的源极和栅极的电压差。
    本发明实施例提供的一种像素补偿电路,包括:
    第一薄膜晶体管、第二薄膜晶体管、第三薄膜晶体管、第四薄膜晶体管、第五薄膜晶体管、第六薄膜晶体管、发光器件和电容;其中,
    第一薄膜晶体管作为驱动管,其栅极与驱动管栅极节点相连,其另外两极分别与驱动管源极节点和高电平输入节点相连;
    第二薄膜晶体管的栅极与第一扫描信号输入节点相连,其另外两极分别与驱动管栅极节点和高电平输入节点相连;
    第三薄膜晶体管的栅极与第二扫描信号输入节点相连,其另外两极分别与驱动管栅极节点和信号供给节点相连;
    第四薄膜晶体管的栅极与第三扫描信号输入节点相连,其另外两极分别与驱动管源极节点和低电平输入节点相连;
    第五薄膜晶体管的栅极与第一扫描信号输入节点相连,其另外两极分别与数据信号输入节点和信号供给节点相连;
    第六薄膜晶体管的栅极与第二扫描信号输入节点相连,其另外两极分别与驱动管源极节点和输出节点相连;
    发光器件连接在接地点与输出节点之间;
    电容连接在驱动管源极节点和信号供给节点之间。
    本发明提供的一种显示器装置,包括级联的上述像素补偿电路。
    本发明实施例提供的像素补偿电路及显示器,其中像素补偿电路包括:作为驱动管的第一薄膜晶体管,其栅极与驱动管栅极节点相连,其另外两极分别与驱动管源极节点和高电平输入节点相连;栅极与第一扫描信号输入节点相连,其另外两极分别与驱动管栅极节点和高电平输入节点相连的第二薄膜晶体 管;栅极与第二扫描信号输入节点相连,其另外两极分别与驱动管栅极节点和信号供给节点相连的第三薄膜晶体管;栅极与第三扫描信号输入节点相连,其另外两极分别与驱动管源极节点和低电平输入节点相连的第四薄膜晶体管;栅极与第一扫描信号输入节点相连,其另外两极分别与数据信号输入节点和信号供给节点相连的第五薄膜晶体管;栅极与第二扫描信号输入节点相连,其另外两极分别与驱动管源极节点和输出节点相连的第六薄膜晶体管;连接在接地点与输出节点之间的发光器件;连接在驱动管源极节点和信号供给节点之间的电容。本发明实施例提供的像素补偿电路,只需一个稳定电压源,并且补偿过程不受初始化状态和输入信号影响,工作方式稳定。本发明实施例提供的像素补偿电路针对NMOS设计,无需翻转OLED阴阳极,可用于实际生产。另外,本发明实施例提供的像素补偿电路对工艺要求较低,且较少的输入信号可以大大简化平板(Panel)设计,提高显示器每英寸所拥有的像素(pixel per inch,PPI)数目,可以准确输出与进屏信号相关的电流,从而提高实际显示画面色彩的均一性,确保不出现显示异常。
    附图说明
    图1为现有像素补偿电路的原理示意图;
    图2为本发明实施例提供的一种像素补偿电路示意图;
    图3为信号输入状态时三个不同阶段各扫描信号的时序关系示意图;
    图4为阶段I时各扫描信号的时序关系示意图;
    图5为本发明实施例提供的一种像素补偿电路在补偿状态时电路工作原理示意图(黑框代表阶段I关闭的晶体管);
    图6为阶段II时各扫描信号的时序关系示意图;
    图7为本发明实施例提供的一种像素补偿电路在信号输入状态时电路工作原理示意图(黑框代表阶段II关闭的晶体管);
    图8为阶段III时各扫描信号的时序关系示意图;
    图9为本发明实施例提供的一种像素补偿电路在工作状态时电路工作原理示意图(黑框代表阶段III关闭的晶体管);
    图10为本发明实施例提供的另一种像素补偿电路示意图。
    具体实施方式
    本发明实施例提供了一种像素补偿电路及显示器,用以补偿像素中NMOS驱动管的阈值漂移,也用以锁定像素中NMOS驱动管的源极,栅极电压差。
    本发明实施例提供的一种像素补偿电路,包括:第一开关单元、第二开关单元、第三开关单元、第四开关单元、第五开关单元、第六开关单元、发光器件和电容;第一开关单元、第二开关单元、第三开关单元、第四开关单元、第五开关单元、第六开关单元均包括三个连接端,其中,
    第一开关单元的第一连接端连接在第二开关单元和第三开关单元之间,第二连接端连接在电容和第四开关单元之间,第三连接端与高电平输入节点相连;
    第二开关单元的第一连接端与第一扫描信号输入节点相连,第二连接端与高电平输入节点相连,第三连接端与第三开关单元相连;
    第三开关单元的第一连接端与第二扫描信号输入节点相连,第二连接端与第二开关单元相连,第三连接端连接在电容和第五开关单元之间;
    第四开关单元的第一连接端与第三扫描信号输入节点相连,第二连接端与低电平输入节点相连,第三连接端连接在第一开关单元和第六开关单元之间;
    第五开关单元的第一连接端与第一扫描信号输入节点相连,第二连接端与数据信号输入节点相连,第三连接端与电容相连;
    第六开关单元的第一连接端与第二扫描信号输入节点相连,第二连接端与发光器件相连,第三连接端连接在电容和第四开关单元之间;
    发光器件连接在接地点与第六开关单元之间;
    电容连接在第四开关单元和第五开关单元之间。
    较佳地,所述第一开关单元为第一薄膜晶体管,第二开关单元为第二薄膜晶体管、第三开关单元为第三薄膜晶体管、第四开关单元为第四薄膜晶体管、第五开关单元为第五薄膜晶体管、第六开关单元为第六薄膜晶体管。
    下面结合附图对本发明实施例提供的技术方案进行描述。
    参见图2,本发明实施例提供的一种像素补偿电路,包括:
    第一薄膜晶体管M1、第二薄膜晶体管M2、第三薄膜晶体管M3、第四薄膜晶体管M4、第五薄膜晶体管M5、第六薄膜晶体管M6、发光器件D_EMIT和电容C1;其中,
    第一薄膜晶体管M1作为驱动管,其栅极与驱动管栅极节点P_Gate相连,其另外两极分别与驱动管源极节点P_Source和高电平输入节点VDD相连;
    第二薄膜晶体管M2的栅极与第一扫描信号输入节点Scan相连,其另外两极分别与驱动管栅极节点P_Gate和高电平输入节点VDD相连;
    第三薄膜晶体管M3的栅极与第二扫描信号输入节点Emit相连,其另外两极分别与驱动管栅极节点P_Gate和信号供给节点P_Store相连;
    第四薄膜晶体管M4的栅极与第三扫描信号输入节点Rev相连,其另外两极分别与驱动管源极节点P_Source和低电平输入节点Ref相连;
    第五薄膜晶体管M5的栅极与第一扫描信号输入节点Scan相连,其另外两极分别与数据信号输入节点Data和信号供给节点P_Store相连;
    第六薄膜晶体管M6的栅极与第二扫描信号输入节点Emit相连,其另外两极分别与驱动管源极节点P_Source和输出节点P_Output相连;
    发光器件D_EMIT连接在接地点0与输出节点P_Output之间;
    电容C1连接在驱动管源极节点P_Source和信号供给节点P_Store之间。
    较佳地,所有所述薄膜晶体管均为N型薄膜晶体管。
    较佳地,所述发光器件为发光二极管或量子点发光层。
    较佳地,当所述发光器件为发光二极管时,所述发光二极管的阴极与接地 点相连,阳极与输出节点相连。
    较佳地,所述发光二极管为量子点发光二极管QLED或有机发光二极管OLED。
    较佳地,所述第一薄膜晶体管M1的漏级与高电平输入节点VDD相连,源极与驱动管源极节点P_Source相连。
    本发明实施例提供的技术方案中所述的NMOS像素补偿电路,通过追加一个薄膜晶体管M4,在阶段II通过低电平输入节点Ref引入一个低电平(V_Ref)。使得薄膜晶体管M1源级电压可以自动补偿变为VDD-V_th,从而可以在数据信号(Data)输入前关闭薄膜晶体管M6,这也使得像素补偿电路所需的三组控制信号Scan、Emit和Rev中只有一组为反相信号。并且一个低的电位V_Ref的引入保证了薄膜晶体管M1在补偿状态下的打开。最终补偿结果,薄膜晶体管M1栅源压差为V_Data-VDD+V_th,其中V_th为薄膜晶体管M1的阈值电压。
    本发明实施例提供的像素补偿电路的各扫描信号的时序关系如图3所示,图3中示出了阶段I、阶段II和阶段III三个不同的扫描信号阶段。在阶段I,第一扫描信号Scan为正向扫描信号,第二扫描信号Emit与第三扫描信号Rev为反向扫描信号;在阶段II,第一扫描信号Scan与第三扫描信号Rev均为正向扫描信号,第二扫描信号Emit为反向扫描信号,在阶段III,第二扫描信号Emit为正向扫描信号,第一扫描信号Scan与第三扫描信号Rev均为反向扫描信号。
    在阶段I,即在补偿状态时的各扫描信号的时序关系如图4所示,在该状态下,第一扫描信号Scan为正向扫描信号,第二扫描信号Emit与第三扫描信号Rev均为反向扫描信号,因此栅极与第二扫描信号Emit相连的第三薄膜晶体管M3与第六薄膜晶体管M6处于关闭状态,栅极与第三扫描信号Rev相连的第四薄膜晶体管M4也处于关闭状态,如图5所示,第一薄膜晶体管M1、第二薄膜晶体管M2和第五薄膜晶体管M5处于导通状态。电容C1的信号供 给P_Store端电压为V_Data,另一端因第四薄膜晶体管M4关断电平回升至VDD-V_th,因此,电容C1两端压差为V_Data-VDD+V_th。
    在阶段II,即信号输入状态时的各扫描信号的时序关系如图6所示,在该状态下,第一扫描信号Scan与第三扫描信号Rev均为正向扫描信号,第二扫描信号Emit为反向扫描信号,因此栅极与第二扫描信号Emit相连的第三薄膜晶体管M3和第六薄膜晶体管M6处于关闭状态,如图7所示。第一薄膜晶体管M1、第二薄膜晶体管M2、第四薄膜晶体管M4和第五薄膜晶体管M5都处于导通状态。电容C1的信号供给P_Store端电压为V_Data,电容C1另一端为一个低电平V_Ref,为下一步正确的阈值补偿做好准备。
    在阶段III,即工作状态时的各扫描信号的时序关系如图8所示,在该状态下,第二扫描信号Emit为正向扫描信号,第一扫描信号Scan与第三扫描信号Rev均为反向扫描信号,因此栅极与第一扫描信号Scan相连的第二薄膜晶体管M2与第五薄膜晶体管M5处于关闭状态,栅极与第三扫描信号Rev相连的第四薄膜晶体管M4也处于关闭状态,如图9所示,第一薄膜晶体管M1、第三薄膜晶体管M3和第六薄膜晶体管M6处于导通状态。驱动管(M1)源级和栅极通过存储电容C1耦合,锁定M1的栅源电压差为V_Data-VDD+V_th,使像素补偿电路输出准确的电流K_n(V_Data-VDD)2,其中K n=μCW/(2L),μ为晶体管沟道中载流子迁移率;C为晶体管绝缘层单位面积电容;W为晶体管沟道宽度;L为晶体管沟道长度。
    较佳地,图2中所示的接地点和低电平输入节点Ref可以相连,以减少一条引线,从而减小像素补偿电路的面积。本发明实施例提供的另一种像素补偿电路的具体结构参见图10,包括:薄膜晶体管M7、薄膜晶体管M8、薄膜晶体管M9、薄膜晶体管M10、薄膜晶体管M11、薄膜晶体管M12、发光器件D_EMIT1和电容C2;其中,
    薄膜晶体管M7作为驱动管,其栅极与驱动管栅极节点P_Gate相连,其另外两极分别与驱动管源极节点P_Source和高电平输入节点VDD相连;
    薄膜晶体管M8的栅极与第一扫描信号输入节点Scan相连,其另外两极分别与数据信号输入节点Data和信号供给节点P_Store相连;
    薄膜晶体管M9的栅极与第二扫描信号输入节点Emit相连,其另外两极分别与驱动管源极节点P_Source和输出节点P_Output相连;
    薄膜晶体管M10的栅极与第三扫描信号输入节点Rev相连,其另外两极分别与驱动管源极节点P_Source和接地点0相连;
    薄膜晶体管M11的栅极与第一扫描信号输入节点Scan相连,其另外两极分别与驱动管栅极节点P_Gate和高电平输入节点VDD相连;
    薄膜晶体管M12的栅极与第二扫描信号输入节点Emit相连,其另外两极分别与驱动管栅极节点P_Gate和信号供给节点P_Store相连;
    发光器件D_EMIT1连接在接地点0与输出节点P_Output之间;
    电容C2连接在驱动管源极节点P_Source和信号供给节点P_Store之间。
    图10中所示电路的具体工作原理同图2所示电路的工作原理,在此不进行赘述。
    本发明实施例提供的一种显示器,该显示器包括上面所述的像素补偿电路的电路结构。
    较佳地,所述显示器为平板显示器,也可以是其它类型的显示器。
    综上所述,本发明实施例提供的技术方案中,只需一个稳定电压源,并且补偿过程不受初始化状态和输入信号影响,工作方式稳定。本发明实施例提供的技术方案针对NMOS设计,无需翻转OLED阴阳极,可用于实际生产。另外,本发明实施例提供的技术方案对工艺要求较低,且较少的输入信号可以大大简化平板(Panel)设计,提高显示器每英寸所拥有的像素(pixel per inch,PPI)数目。
    显然,本领域的技术人员可以对本发明进行各种改动和变型而不脱离本发明的精神和范围。这样,倘若本发明的这些修改和变型属于本发明权利要求及其等同技术的范围之内,则本发明也意图包含这些改动和变型在内。

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