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    重庆时时彩近十期走势: 一种保持占空比的组合逻辑电路.pdf

    摘要
    申请专利号:

    重庆时时彩单双窍门 www.4mum.com.cn CN201210595906.3

    申请日:

    2012.12.28

    公开号:

    CN103914578A

    公开日:

    2014.07.09

    当前法律状态:

    撤回

    有效性:

    无权

    法律详情: 发明专利申请公布后的视为撤回IPC(主分类):G06F 17/50申请公布日:20140709|||著录事项变更IPC(主分类):G06F 17/50变更事项:申请人变更前:北京中电华大电子设计有限责任公司变更后:北京中电华大电子设计有限责任公司变更事项:地址变更前:100102 北京市朝阳区利泽中二路2号望京科技创业园A座五层变更后:102209 北京市昌平区北七家未来科技城南区中国电子网络安全和信息化产业基地C栋|||实质审查的生效IPC(主分类):G06F 17/50申请日:20121228|||公开
    IPC分类号: G06F17/50 主分类号: G06F17/50
    申请人: 北京中电华大电子设计有限责任公司
    发明人: 杨逸轩; 王延斌; 蒙卡娜; 包乌日吐
    地址: 100102 北京市朝阳区利泽中二路2号望京科技创业园A座五层
    优先权:
    专利代理机构: 代理人:
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201210595906.3

    授权公告号:

    |||||||||

    法律状态公告日:

    2017.06.06|||2015.10.28|||2014.08.06|||2014.07.09

    法律状态类型:

    发明专利申请公布后的视为撤回|||著录事项变更|||实质审查的生效|||公开

    摘要

    本发明提出了一种保持占空比的组合逻辑电路实现结构,该电路结构具有保持输入输出信号占空比的特点。该发明适用于输入输出信号占空比一致性要求较高的电路设计领域,如双沿采样的同步电路设计领域。通过本发明可完成集成电路中时钟路径占空比保持,优势在于使得经组合逻辑的时钟信号占空比保持与输入信号一致,使得集成电路中数字电路建立(setup)时间更易满足收敛要求。

    权利要求书

    权利要求书
    1.  一种保持占空比的组合逻辑电路,其特征在于:
    1)若所需逻辑在标准单元库中提供输出取反的相同逻辑单元,则保持时钟占空比的组合逻辑电路由2个相同驱动能力的前级逻辑单元和后级逻辑单元构成,前级逻辑单元和后级逻辑单元相互串联,组合逻辑电路的输入连接至前级逻辑单元的输入,前级逻辑单元的输出连接至后级逻辑单元的一个输入,后级逻辑单元的其他输入接固定电平;
    2)若所需逻辑在标准单元库中未提供输出取反的相同逻辑单元,仅提供与所需逻辑一致的逻辑单元,则保持时钟占空比的组合逻辑电路由2个相同驱动能力的前级逻辑单元和后级组合逻辑单元及2个相同驱动能力的前级反相器和后级反相器构成,前级逻辑单元和后级组合逻辑单元及前级反相器和后级反相器串联,组合逻辑电路的输入连接至前级逻辑单元的输入,将前级逻辑单元的输出连接前级反相器的输入,再将前级反相器的输出连接至后级逻辑单元的一个输入,后级逻辑单元的输出连接至后级反相器的输入,后级反相器的输出作为组合逻辑电路的输出信号,后级逻辑单元的其他输入接固定电平。

    关 键 词:
    一种 保持 组合 逻辑电路
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