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    显示装置
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    摘要
    申请专利号:

    CN201410696924.X

    申请日:

    2014.11.26

    公开号:

    CN104680989A

    公开日:

    2015.06.03

    当前法律状态:

    撤回

    有效性:

    无权

    法律详情: 发明专利申请公布后的视为撤回 IPC(主分类):G09G 3/36申请公布日:20150603|||实质审查的生效IPC(主分类):G09G 3/36申请日:20141126|||公开
    IPC分类号: G09G3/36 主分类号: G09G3/36
    申请人: 三星显示有限公司
    发明人: 安益贤; 金润龟; 朴奉任; 孙浩硕
    地址: 韩国京畿道
    优先权: 10-2013-0144708 2013.11.26 KR
    专利代理机构: 北京市柳沈律师事务所11105 代理人: 邵亚丽; 刘虹
    PDF完整版下载: PDF下载
    法律状态
    申请(专利)号:

    CN201410696924.X

    授权公告号:

    ||||||

    法律状态公告日:

    2019.03.12|||2017.01.04|||2015.06.03

    法律状态类型:

    发明专利申请公布后的视为撤回|||实质审查的生效|||公开

    摘要

    公开了一种具有定时控制器的显示装置。在一方面,所述显示装置包括:第一和第二栅极驱动器;第一和第二栅极线,其从所述第一和第二栅极驱动器沿第一和第二方向延伸;数据线,其沿第三方向延伸;显示面板,其包括电连接到所述第一和第二栅极线以及所述数据线的像素;数据驱动电路,其中的每个响应于输出起始信号和数据信号驱动对应的数据线;以及定时控制器。所述定时控制器,在所述第一栅极线被驱动时,根据所述第一栅极驱动器与所述数据驱动电路之间沿所述第一方向的距离,设置所述数据信号的输出定时;以及,在所述第二栅极线被驱动时,根据所述第二栅极驱动器与所述数据驱动电路之间沿所述第二方向的距离,设置所述数据信号的输出定时。

    权利要求书

    权利要求书
    1.  一种显示装置,包括:
    第一栅极驱动器;
    第二栅极驱动器;
    多个第一栅极线,其从所述第一栅极驱动器沿第一方向延伸;
    多个第二栅极线,其从所述第二栅极驱动器沿第二方向延伸;
    多个数据线,其沿基本上垂直于所述第一和第二方向的第三方向延伸;
    显示面板,其包括电连接到所述第一和第二栅极线以及所述数据线的多 个像素;
    多个数据驱动电路,其中的每个被配置为,响应于输出起始信号和数据 信号,驱动所述数据线中对应的数据线;
    定时控制器,被配置为施加所述输出起始信号和所述数据信号到所述数 据驱动电路,以及控制所述第一和第二栅极驱动器;
    其中,所述定时控制器进一步被配置为,当所述第一栅极线被驱动时, 根据所述第一栅极驱动器与所述数据驱动电路之间沿所述第一方向的距离, 设置施加于每个所述数据驱动电路的所述数据信号的第一输出定时,
    并且被配置为,当所述第二栅极线被驱动时,根据所述第二栅极驱动器 与所述数据驱动电路之间沿所述第二方向的距离,设置施加于每个所述数据 驱动电路的所述数据信号的第二输出定时。

    2.  如权利要求1所述的显示装置,其中,所述定时控制器进一步被配置 为,当所述第一栅极线被驱动时,随着所述第一栅极驱动器与所述数据驱动 电路之间沿所述第一方向的距离变得更长,增加施加于每个所述数据驱动电 路的所述数据信号的所述第一输出定时的延迟时间。

    3.  如权利要求1所述的显示装置,其中,所述定时控制器进一步被配置 为,当所述第二栅极线被驱动时,随着所述第二栅极驱动器与所述数据驱动 电路之间沿所述第二方向的距离变得更长,增加施加于每个所述数据驱动电 路的所述数据信号的所述第二输出定时的延迟时间。

    4.  如权利要求3所述的显示装置,其中,所述第一方向和所述第二方向 是彼此相反的。

    5.  如权利要求4所述的显示装置,其中,所述数据线被分组为多个数据 线组,并且所述数据驱动电路与所述数据线组相对应。

    6.  如权利要求5所述的显示装置,其中所述第一栅极驱动器被配置为顺 序地施加第一栅极信号到所述第一栅极线,以及第二栅极驱动器被配置为顺 序地施加第二栅极信号到所述第二栅极线。

    7.  如权利要求6所述的显示装置,其中,所述定时控制器进一步被配置 为,按照与施加于所述第一栅极线的所述第一栅极信号沿所述第一方向的延 迟时间对应的时间,沿所述第一方向顺序地延迟施加于每个所述数据驱动电 路的所述数据信号的所述第一输出定时。

    8.  如权利要求6所述的显示装置,其中,所述定时控制器进一步被配置 为,按照与施加于所述第二栅极线的所述第二栅极信号沿所述第二方向的延 迟时间对应的时间,沿所述第二方向顺序地延迟施加于每个所述数据驱动电 路的所述数据信号的所述第二输出定时。

    9.  如权利要求5所述的显示装置,其中,所述定时控制器进一步被配置 为,当所述第一栅极线被驱动时,补偿所述数据信号;
    其中所述数据信号是根据所述第一栅极驱动器与所述数据信号显示在 所述显示面板上的位置之间沿所述第一方向的距离进行补偿的。

    10.  如权利要求9所述的显示装置,其中,所述定时控制器进一步被配 置为,当所述第二栅极线被驱动时,补偿所述数据信号;
    其中所述数据信号是根据所述第二栅极驱动器与所述数据信号显示在 所述显示面板上的位置之间沿所述第二方向的距离,进行补偿的。

    11.  如权利要求5所述的显示装置,其中,所述定时控制器进一步被配 置为,根据所述数据驱动电路与所述数据信号显示在所述显示面板上的位置 之间沿所述第三方向的距离,来补偿所述数据信号。

    12.  如权利要求11所述的显示装置,其中,所述定时控制器进一步被配 置为,随着所述数据驱动电路与所述数据信号显示在所述显示面板上的位置 之间沿所述第三方向的所述距离的增加,增加所述数据信号的补偿量。

    13.  如权利要求1所述的显示装置,其中,所述第一栅极驱动器邻近所 述显示面板的第一端而放置,以及所述第二栅极驱动器邻近所述显示面板的 第二端而放置。

    14.  如权利要求13所述的显示装置,其中,所述数据驱动电路沿所述第 一方向顺序地布置为邻近所述显示面板的第一长边。

    15.  如权利要求13所述的显示装置,其中,所述第一栅极线和所述第二 栅极线逐个交替地布置。

    16.  一种显示装置,包括:
    第一栅极驱动器;
    多个第一栅极线,其从所述第一栅极驱动器沿第一方向延伸;
    多个数据线,其沿基本上垂直于所述第一方向的第三方向延伸;
    显示面板,其包括电连接到所述第一栅极线以及所述数据线的多个像 素;
    多个数据驱动电路,其中的每个被配置为,响应于输出起始信号和数据 信号,驱动所述数据线中对应的数据线;以及
    定时控制器,被配置为施加所述输出起始信号和所述数据信号到所述数 据驱动电路,以及控制所述第一栅极驱动器,
    其中,所述定时控制器进一步被配置为,当所述第一栅极线被驱动时, 根据所述第一栅极驱动器与所述数据驱动电路之间沿所述第一方向的距离, 设置施加于每个所述数据驱动电路的所述数据信号的第一输出定时。

    说明书

    说明书显示装置
    相关申请的交叉引用
    本申请要求于2013年11月26日提交的韩国专利申请第 10-2013-0144708号的优先权,通过引用将其全部公开内容结合于此。
    技术领域
    所描述的技术总体上涉及一种显示装置,特别地,涉及一种具有改善的 显示质量的显示装置。
    背景技术
    一般地,显示装置包括:用于显示图像的显示面板,及用于驱动所述显 示面板的数据驱动器和栅极驱动器。所述显示面板包括:栅极线,数据线, 和像素。每个像素包括薄膜晶体管,液晶电容器和存储电容器。所述数据驱 动器施加数据驱动信号到所述数据线,而所述栅极驱动器施加栅极驱动信号 的所述栅极线。
    所述显示装置通过所述栅极线中的对应的栅极线将栅极导通电压施加 到所述薄膜晶体管的栅电极,并通过所述数据线中的对应的数据线施加与所 述图像对应的数据电压到所述薄膜晶体管的源电极,并由此获得所需的图 像。所述数据电压,其在所述薄膜晶体管导通时对所述液晶电容器和所述存 储电容器充电,在所述薄膜晶体管被关断后需要被保持预定的时间。
    发明内容
    一个创造性方面是一种能够防止显示质量的劣化而无论所述显示装置 的尺寸如何增加的显示装置。
    另一个方面是一种能够实现窄边框的显示装置。
    另一个方面是一种显示装置,其包括第一栅极驱动器;第二栅极驱动器; 多个第一栅极线,其从所述第一栅极驱动器沿第一方向延伸;多个第二栅极 线,其从所述第二栅极驱动器沿第二方向延伸;多个数据线,其沿基本上垂 直于所述第一和第二方向的第三方向延伸;显示面板,其包括电连接到所述 第一和第二栅极线以及所述数据线的多个像素;多个数据驱动电路,其中的 每个被配置为,响应于输出起始信号和数据信号,驱动所述数据线中对应的 数据线;定时控制器,被配置为施加所述输出起始信号和所述数据信号到所 述数据驱动电路,以及控制所述第一和第二栅极驱动器。所述定时控制器进 一步被配置为,当所述第一栅极线被驱动时,根据所述第一栅极驱动器与所 述数据驱动电路之间沿所述第一方向的距离,设置施加于每个所述数据驱动 电路的所述数据信号的输出定时;并且被配置为,当所述第二栅极线被驱动 时,根据所述第二栅极驱动器与所述数据驱动电路之间沿所述第二方向的距 离,设置施加于每个所述数据驱动电路的所述数据信号的第二输出定时。
    在示例性实施例,所述定时控制器进一步被配置为,当所述第一栅极线 被驱动时,随着所述第一栅极驱动器与所述数据驱动电路之间沿所述第一方 向的距离变得更长,增加施加于每个所述数据驱动电路的所述数据信号的输 出定时的延迟时间。
    在示例性实施例,所述定时控制器进一步被配置为,当所述第二栅极线 被驱动时,随着所述第二栅极驱动器与所述数据驱动电路之间沿所述第二方 向的所述距离变得更长,增加施加于每个所述数据驱动电路的所述数据信号 的所述第二输出定时的延迟时间。
    在示例性实施例中,所述第一方向和所述第二方向是彼此相反的。
    在示例性实施例中,所述数据线被分组为多个数据线组,并且所述数据 驱动电路与所述数据线组相对应。
    在示例性实施例中,所述第一栅极驱动器被配置为顺序地施加第一栅极 信号到所述第一栅极线,以及第二栅极驱动器被配置为顺序地施加第二栅极 信号到所述第二栅极线。
    在示例性实施例中,所述定时控制器进一步被配置为,按照与施加于所 述第一栅极线的所述第一栅极信号沿所述第一方向的延迟时间对应的时间, 沿所述第一方向顺序地延迟施加于每个所述数据驱动电路的所述数据信号 的所述第一输出定时。
    在示例性实施例中,所述定时控制器进一步被配置为,按照与施加于所 述第二栅极线的所述第二栅极信号沿所述第二方向的所述延迟时间对应的 时间,沿所述第二方向顺序地延迟施加于每个所述数据驱动电路的所述数据 信号的所述第二输出定时。
    在示例性实施例中,所述定时控制器进一步被配置为,当所述第一栅极 线被驱动时,补偿所述数据信号;其中所述数据信号是根据所述第一栅极驱 动器与所述数据信号显示在所述显示面板上的位置之间沿所述第一方向的 距离,进行补偿的。
    在示例性实施例中,所述定时控制器进一步被配置为,当所述第二栅极 线被驱动时,补偿所述数据信号;其中所述数据信号是根据所述第二栅极驱 动器与所述数据信号显示在所述显示面板上的位置之间沿所述第二方向的 距离,进行补偿的。
    在示例性实施例中,所述定时控制器进一步被配置为,根据所述数据驱 动电路与所述数据信号显示在所述显示面板上的位置之间沿所述第三方向 的距离,补偿所述数据信号。
    在示例性实施例,所述定时控制器进一步被配置为,随着所述数据驱动 电路与所述数据信号显示在所述显示面板上的位置之间沿所述第三方向的 距离的增加,增加所述数据信号的补偿量。
    在示例性实施例中,所述第一栅极驱动器邻近所述显示面板的第一端而 放置,以及所述第二栅极驱动器邻近所述显示面板的第二端而放置。
    在示例性实施例中,所述数据驱动电路沿所述第一方向顺序地放置为邻 近所述显示面板的第一长边。
    在示例性实施例中,所述第一栅极线和所述第二栅极线逐个交替地布 置。
    另一个方面是一种显示装置,其包括:第一栅极驱动器;多个第一栅极 线,其从所述第一栅极驱动器沿第一方向延伸;多个数据线,其沿基本上垂 直于所述第一方向的第三方向延伸;显示面板,其包括电连接到所述第一栅 极线以及所述数据线的多个像素;多个数据驱动电路,其中的每个被配置为, 响应于输出起始信号和数据信号,驱动所述数据线中对应的数据线;以及, 定时控制器,被配置为施加所述输出起始信号和所述数据信号到所述数据驱 动电路,以及控制所述第一栅极驱动器;其中,所述定时控制器进一步被配 置为,当所述第一栅极线被驱动时,根据所述第一栅极驱动器与所述数据驱 动电路之间沿所述第一方向的距离,设置施加于每个所述数据驱动电路的所 述数据信号的第一输出定时。
    根据本发明构思的实施例,从所述定时控制器输出的所述数据信号的所 述输出定时可根据所述栅极驱动器和所述数据线之间的距离来控制。因此, 所述显示装置的显示质量可得到改善。
    附图说明
    图1为示出根据示例性实施例的显示装置的平面图。
    图2为示出图1中所示的所述显示装置的方框图。
    图3为示出图2中所示的所述第一栅极驱动器的方框图。
    图4为示出图2中所示的所述第二栅极驱动器的方框图。
    图5和6为波形图,其示出施加到图1中所示的所述栅极线中的第一栅 极线的栅极信号,以及数据驱动信号。
    图7为定时图,其示出从图1中所示的定时控制器施加到所述数据驱动 器集成电路的数据信号和输出起始信号。
    图8为定时图,其示出从图1中所示的定时控制器施加到所述数据驱动 器集成电路的数据信号和输出起始信号。
    图9为示出根据所述栅极信号的延迟设置数据信号的输出定时的方法的 图。
    图10为示出根据所述栅极信号通过其他栅极线的延迟,设置数据信号 的输出定时的方法的图。
    图11为示出在图1中所示的所述显示面板内显示的图像的图。
    图12为示出补偿施加到图11中所示的显示面板的数据驱动信号的示例 的图。
    图13为示出补偿施加到图11中所示的显示面板的数据驱动信号的另一 示例的图。
    具体实施方式
    近年来,对具有大屏幕和高驱动速度的显示设备的需求有所增加,并且 因此,发生在栅极线的信号延迟降低了图像质量。也存在这样的问题,距离 栅极驱动器相对较远液晶电容器的充电速率比距离栅极驱动器相对较近的 液晶电容器的充电速率低。
    应当理解的是,当元件或层被称为“在…上”,“连接到”或“耦合到” 另一元件或层时,其可以直接在另一元件或层上,连接到或耦合到另一元件 或层,或者可以存在中间元件或层。相反,当一个元件被称为“直接在…上”, “直接连接到”或“直接耦合到”另一元件或层时,不存在中间元件或中间 层。相同的参考标号始终指代相同的元件。如本文所用的术语“和/或”包括相 关联的列出项中的任一项以及相关联的列出项中的一个或多个的所有组合。
    应当理解的是,尽管术语第一,第二等在本文中可以用来描述不同的元 件,部件,区域,层和/或部分,但是这些元件,组件,区域,层和/或部分 不应受这些术语的限制。这些术语仅用于将一个元件,部件,区域,层或部 分与另一个元件,部件,区域,层或部分进行区分。因此,在不脱离本公开 内容的教导的情况下,以下讨论的第一元件,部件,区域,层或部分可以被 称为第二元件,部件,区域,层或部分。
    空间相对术语,如“在...之下”,“下方”、“下面”,“上方”,“上面”和类似 词,在本文中为了便于描述可以用于描述如附图中示出一个元件或特征与另 一个元件(多个元件)或特征(多个特征)的关系??梢岳斫獾氖?,空间相 对术语意在除了在附图中描述的方位之外还包含该装置在使用或操作中不 同的方位。例如,如果附图中的装置被翻转,则描述为在其它元件或特征“下 方”或“之下”的元件或特征将被定向为在其它元件或特征“上方”。因此,示例 性术语“下方”可包括上方和下方两种方位。该装置可以其它方式定位(旋转 90度或者在其它方位),并且本文所用的空间相对描述符可以相应地来解释。
    本文所用的术语仅为描述特定实施例的目的,而并不是用来限定。如本 文所使用的,单数形式“一”,“一个”和“该”意味着也包括复数形式,除非上 下文明确地指出并非如此。应进一步理解的是,术语“包含(include)”和/ 或“包含(including)”,在本说明书中使用时,是指存在所述特征、整体、 步骤、操作、元件、和/或组件,但不排除存在或添加一个或多个其它特征, 整体,步骤,操作,元件,组件和/或它们的组合。
    除非另有定义,本文使用的所有术语(包括技术和科学术语)与本领域 中普通技术人员通常理解的含义相同。应当进一步理解,诸如那些在常用字 典中定义的术语,应该被理解为具有与其在相关领域的上下文中的含义相一 致的含义,并且不要在理想化或过于刻板的意义上来解释,除非在此明确地 这样定义。
    现将在下文中结合附图更充分地描述示例实施例。然而,所描述的实施 例可以以不同的形式实现,并且不应被解释为受限于本文所阐述的实施例。 更确切地,提供了这些实施例是为了使本公开全面和完整,并将向本领域技 术人员充分传达所描述的技术的范围。
    在附图中,尺寸可以为了阐释清楚而被夸大。应当理解,当一个元件被 称为在两个元件“之间”时,它可以是在这两个元件之间的唯一元件,或者 也可以存在一个或多个中间元件。
    图1为示出根据本公开内容的示例性实施例的显示装置的平面图,并且, 图2为示出图1中所示的显示装置的方框图。
    参照图1和图2,显示装置100包括显示面板110,印刷电路板121和 122,控制板130,数据驱动电路141至146,以及第一栅极驱动器160和第 二栅极驱动器170。附图中的印刷电路板、控制板、和驱动电路的数量是示 例性的。在不脱离本申请的公开内容的情况下,所属领域的普通技术人员可 以设想到更多的组件或更少的组件。
    显示面板110包括在其中布置有多个像素PX的一显示区域AR,以及 邻近所述显示区域AR形成的非显示区域NAR。所述显示区域AR显示图像, 而非显示区域NAR不显示任何图像。显示面板110可以是玻璃基板,硅基 板或薄膜基板。也可使用其它材料。
    印刷电路板121和122包括:控制板130和多个连接到所述第一栅极驱 动器160和第二栅极驱动器170和所述数据驱动电路141至146的多条线。
    控制板130分别通过线缆131和133电连接到印刷电路板121和122。 控制电路板130包括定时控制器132和时钟发生器134。
    定时控制器132通过所述线缆131和133施加数据信号DATA1至DATA6 和输出起始信号TP1至TP6到所述数据驱动电路141至146。定时控制器 132也施加垂直起始信号STV到所述第一栅极驱动器160和第二栅极驱动器 170。定时控制器132进一步施加水平同步起始信号和行锁存信号(line latch  signal)到所述数据驱动电路141至146。定时控制器132进一步施加输出使 能信号到所述第一栅极驱动器160和第二栅极驱动器170。定时控制器132 施加栅极脉冲信号CPV到所述时钟发生器134。
    所述时钟发生器134响应于所述栅极脉冲信号CPV输出第一栅极时钟 信号CKV和第二栅极时钟信号CKVB。所述第一栅极时钟信号CKV被施加 到所述第一栅极驱动器160而第二栅极时钟信号CKVB施加到所述第二栅极 驱动器170。所述第一栅极时钟信号CKV和第二栅极时钟信号CKVB是彼 此互补的。
    所述数据驱动电路141至146可以通过例如带载封装(TCP)或者覆晶 薄膜(chip-on-film,COF)实现。也可以使用其他实现方式。所述数据驱动 器集成电路151至156分别被安装在所述数据驱动电路141至146上。数据 驱动电路151至156中的每一个响应于所述数据信号DATA1至DATA6中对 应的数据信号以及所述输出起始信号TP1至TP6中对应的输出起始信号, 而驱动数据线。所述数据驱动器集成电路151至156可以直接安装在显示面 板110上,而不被置于所述印刷电路板121和122上。
    所述数据驱动电路141至146中的每一个使用数据驱动信号来驱动所述 数据线DL11至DL6K中对应的K个数据线,其中,K是一个正整数。在本 示例性实施例中,数据驱动器集成电路151至156中的每一个可以响应于从 所述定时控制器132提供的所述输出起始信号TP1至TP6,来改变施加于所 述的数据线DL11至DL6K的所述数据驱动信号的输出定时。所述数据线 DL11至DL6K从所述数据驱动器集成电路151至156沿第三方向X3延伸。
    所述数据驱动电路141至146被顺序地沿第一方向X1布置,并邻近所 述显示面板110的第一长边而放置。所述第一栅极驱动器160邻近所述显示 面板110的第一短边而放置,以及所述第二栅极驱动器170邻近所述显示面 板110的第二短边而放置。
    所述第一栅极驱动器160和第二栅极驱动器170以采用非晶硅栅薄膜晶 体管(a-Si TFT),氧化物半导体,结晶半导体,或者多晶半导体的电路来配 置,并集成于所述显示面板110的所述非显示区域NAR中。根据另一实施 例,所述第一栅极驱动器160和第二栅极驱动器170可以分别以TCP或COF 的形式附接于所述显示面板110的第一短边和第二短边。其它附接方法也可 以使用。
    所述第一栅极驱动器160响应于来自所述定时控制器132的所述垂直起 始信号STV和来自所述时钟发生器134的所述第一栅极时钟信号CKV,驱 动第一组栅极线GL1至GLn-1(在下文中称为第一栅极线组)。所述第一栅 极线组GL1至GLn-1从所述第一栅极驱动器160沿所述第一方向X1延伸。 所述第一栅极线组GL1至GLn-1包括栅极线GL1至GLn中奇数编号的栅极 线。
    所述第二个栅极驱动器170响应于来自所述定时控制器132的所述垂直 起始信号STV和来自所述时钟发生器134的所述第二栅极时钟信号CKVB, 驱动第二组栅极线GL2至GLn(在下文中称为第二栅极线组)。所述第二栅 极线组GL2至GLn从所述第二栅极驱动器170沿所述第二方向X2延伸。 所述第一方向X1和所述第二方向X2彼此相反。所述第二栅极线组GL2至 GLn包括栅极线GL1至GLn中偶数编号的栅极线。
    图3为示出图2中所示的所述第一栅极驱动器的方框图。
    参见图3,所述第一栅极驱动器160包括多个级ST1至STn-1和伪级 (dummy stage)STn+1。所述级ST1至STn-1分别对应于第一栅极线组GL1 至GLn-1,其为奇数编号的栅极线。所述级ST1至STn-1中的第一级ST1 从下一级接收垂直起始信号STV,所述栅极时钟信号CKV,地电压VSS, 和下一进位信号CR3,并输出进位信号CR1和栅极信号G1。所述栅极信号 G1施加于图2所示的所述栅极线GL1。
    所述级ST1至STn-1中除了第一级ST1之外的每个级STi(i=3,5,..., n-1)接收来自前一级的前一进位信号CRi-2,所述栅极时钟信号CKV,所 述地电压VSS,以及下一进位信号CRi+2,并输出进位信号CRi和栅极信号 Gi。所述栅极信号Gi被施加于图2所示的所述栅极线GLi。
    伪级STn+1接收前一进位信号CRn-1,所述栅极时钟信号CKV,所述 地电压VSS,以及所述垂直起始信号STV,并输出进位信号CRn+1和栅极 信号GDn+1(未示出)。
    图4为示出图2中所示的所述第二栅极驱动器的方框图。
    参见图4,所述第二栅极驱动器170包括多个级ST2至STn和伪级 STn+2。所述级ST2至STn分别对应于第二栅极线GL2至GLn,其为偶数 编号的栅极线。所述级ST2至STn中的第一级ST2从下一级接收垂直起始 信号STV,所述栅极时钟信号CKVB,地电压VSS,和下一进位信号CR4, 并输出进位信号CR2和栅极信号G2。所述栅极信号G2施加于图2所示的 所述栅极线GL2。
    所述级ST2至STn中除了所述第一级ST2之外的每个级STj+1(j=1,3, 5,...,n-1)接收来自前一级的前一进位信号CRj-1,所述栅极时钟信号CKVB, 所述地电压VSS,以及下一进位信号CRj+3,并输出进位信号CRj+1和栅极 信号Gj+1。所述栅极信号Gj+1被施加于图2所示的所述栅极线GLj。
    伪级STn+2接收前一进位信号CRn,所述栅极时钟信号CKVB,所述 地电压VSS,以及所述垂直起始信号STV,并输出进位信号CRn+2。
    该第一栅极驱动器160包括所述级ST1至STn-1和所述伪级STn+1,以 驱动所述第一栅极线组GL1至GLn-1,而所述第二栅极驱动器170包括所述 级ST2至STn和所述伪级STn+2,以驱动所述第二栅极线组GL2至GLn。
    当图3所示的所述级ST1至STn-1和所述伪级STn+1,以及图4所示的 所述级ST2至STn和所述伪级STn+2,都被置于所述显示面板110的边缘时, 则难以实现适用于所述显示面板110的窄边框。
    如图1所示,包括所述级ST1至STn-1和所述伪级STn+1的所述第一 栅极驱动器160被置于所述显示面板110的第一边,并且包括所述级ST2至 STn和所述伪级STn+2的所述第二栅极驱动器170被置于所述显示面板110 的第二边。由于两个栅极驱动器160和170不都在所述显示面板110的单个 边上实现,位于所述显示面板110的第一边的非显示区域NAR的宽度WL 以及位于所述显示面板110的第二边的非显示区域NAR的宽度WR可被降 低。因此,显示装置100的窄边框可以很容易地实现。
    所述第一栅极线组GL1至GLn-1和所述第二栅极线组GL2至GLn逐个 交替地沿所述第三方向X3布置。所述第三方向X3基本上垂直于所述第一 方向X1和所述第二方向X2。在本示例性实施例中,所述第一栅极线组GL1 至GLn-1包括奇数编号的栅极线而所述第二栅极线组GL2至GLn包括偶数 编号的栅极线。
    当栅极导通信号被施加到栅极线时,连接到该栅极线并布置在同一行中 的开关晶体管导通。所述数据驱动器集成电路151至156将对应于数据信号 DATA的所述数据驱动信号施加到所述数据线DL11到DL6K。施加到数据 线DL11到DL6K的所述数据驱动信号通过导通的开关晶体管施加到相应的 像素。
    图5和6为波形图,其示出施加到图1中所示的所述第一组栅极线的所 述第一栅极线的栅极信号,以及数据驱动信号。图5示出施加到置于邻近所 述栅极驱动器的数据线的数据驱动信号,以及所述栅极信号。图6示出施加 到置于远离所述栅极驱动器的数据线的数据驱动信号,以及所述栅极信号。
    参照图5和6,由图1中的所述第一栅极驱动器160产生的第一栅极信 号G1,通过栅极线GL1传送。第一像素PX1连接到所述栅极线GL1和所 述数据线DL11,以及第二像素PX2被连接到所述栅极线GL1和所述数据线 DL6K。当从所述第一栅极驱动器160输出的第一栅极信号G1被施加到沿第 一方向X1远离所述第一栅极驱动器160形成的所述第二像素PX2时,会被 延迟预定的时间。
    对于所述栅极信号G1,被置于其所在行中的所述开关晶体管导通的时 段,被称为“一个水平周期”或“1H”。当所述第二像素PX2的所述开关晶 体管的所述导通时间由于所述栅极信号G1的延迟而被缩短时,所述第二像 素PX2的充电速率被降低。
    也就是说,尽管该数据驱动器集成电路151到156同时施加所述数据驱 动信号D11到D6K到所述数据线DL11到DL6K,所述第二像素PX2(其与 沿所述第一方向X1邻近所述第一栅极驱动器160形成的所述第一像素PX1 相比沿所述第一方向X1相对远离所述第一栅极驱动器160而形成)的充电 速率依然被降低。
    类似地,由于施加到所述栅极线GL2的所述栅极信号G2的延迟,第四 象素PX4(其与沿所述第二方向X2邻近图1中的所述第二栅极驱动器170 形成的所述第三像素PX3相比沿所述第二方向X2相对远离所述第二栅极驱 动器170而形成)的充电速率被降低。
    在下文中,将详细描述一种方法,其将施加到所述数据线DL11至DL6K 的所述数据驱动信号D11至D6K延迟所述栅极信号G1至Gn的延迟时间, 以补偿通过所述栅极线GL1至GLn传送的所述栅极信号G1至Gn的延迟。
    图7为一时序图,其示出从图1中所示的所述定时控制器施加到所述数 据驱动器集成电路的数据信号和输出起始信号。
    参照图2和图7,所述定时控制器132并行地施加所述数据信号DATA1 至DATA6和所述输出起始信号TP1至TP6至所述数据驱动电路141至146。 即,所述定时控制器132施加所述数据信号DATA1和所述输出起始信号TP1 到所述数据驱动电路141,并施加所述数据信号DATA2和所述输出起始信 号TP2到所述数据驱动电路142,以此类推。
    当所述第一栅极驱动器160驱动所述第一栅极线组GL1至GLn-1时, 从所述定时控制器132输出所述数据信号DATA1到所述数据驱动电路141 的时间点过去预定的延迟时间tda之后,所述定时控制器132输出所述数据 信号DATA2到所述数据驱动电路142。类似地,从所述定时控制器132输 出所述数据信号DATA1到所述数据驱动电路141的时间点过去预定的延迟 时间tdb之后,所述定时控制器132输出所述数据信号DATA3至所述数据 驱动电路143。如上文所述,施加到所述数据驱动电路141至146的所述数 据信号DATA1至DATA6的输出定时被设置为彼此不同,并且因而通过所述 栅极线GL1至GLn-1传送的所述栅极信号G1至Gn的延迟可以被补偿。
    也就是说,当所述第一栅极驱动器160驱动所述第一栅极线组GL1至 GLn-1时,所述定时控制器132根据所述第一栅极驱动器160与所述数据驱 动电路141至146之间沿所述第一方向X1的距离,延迟施加到所述数据驱 动电路141至146的所述数据信号DATA1至DATA6的输出定时。
    在一些实施例中,由于所述数据驱动电路141至146被置于沿所述第一 方向X1远离所述第一栅极驱动器160,所述栅极信号G1至Gn-1的延迟时 间会更长。从而,当所述数据信号DATA1至DATA6的输出定时也逐步地被 延迟时,所述像素的充电速率不降低。
    根据另一个实施例,所述定时控制器132基本上同时输出该数据信号 DATA1至DATA6,但顺序地延迟所述输出起始信号TP1至TP6的输出。一 般而言,介于用于所述显示面板110的第i个横行的数据信号传输周期H1 和用于所述显示面板110的第(i+1)个横行的数据信号传输周期H2之间的 水平消隐周期HB是很短的。在所述定时控制器132基本上同时输出该数据 信号DATA1至DATA6并顺序地延迟所述输出起始信号TP1至TP6的输出 的情况下,所述输出起始信号TP1至TP6的每一个的延迟时间范围是有限 的。
    如图7所示,一种延迟所述数据信号DATA1至DATA6的每一个的输出 定时的方法,可通过设置所述数据信号DATA1至DATA6的每一个的输出定 时而执行,而不考虑水平消隐周期HB的长度。
    图8为一定时图,其示出从图1中所示的所述定时控制器施加到所述数 据驱动器集成电路的数据信号和输出起始信号。
    参照图2和8,所述定时控制器132并行地施加所述数据信号DATA1 至DATA6和所述输出起始信号TP1至TP6至所述数据驱动电路141至146。 即,所述定时控制器132施加所述数据信号DATA1和所述输出起始信号TP1 到所述数据驱动电路141,并施加所述数据信号DATA2和所述输出起始信 号TP2到所述数据驱动电路142,以此类推。
    当所述第二栅极驱动器170驱动所述第二栅极线组GL2至GLn时,从 所述定时控制器132输出所述数据信号DATA6到所述数据驱动电路146的 时间点过去预定的延迟时间tdf之后,所述定时控制器132输出所述数据信 号DATA5到所述数据驱动电路145。类似地,在从所述定时控制器132输 出所述数据信号DATA5到所述数据驱动电路145的时间点过去预定的延迟 时间tdg之后,所述定时控制器132输出所述数据信号DATA4至所述数据 驱动电路144。如上文所述,施加到所述数据驱动电路146至141的所述数 据信号DATA6至DATA1的输出定时被设置为彼此不同,并且因而通过所述 栅极线GL2至GLn传送的所述栅极信号G2至Gn的延迟可以被补偿。
    也就是说,当所述第二栅极驱动器170驱动所述第二栅极线组GL2至 GLn时,所述定时控制器132根据所述第二栅极驱动器170与所述数据驱动 电路146至141之间沿所述第二方向X2的距离,延迟施加到所述数据驱动 电路146至141的所述数据信号DATA6至DATA1的输出定时。
    如图7所描述,当所述第一栅极驱动器160驱动所述第一栅极线组GL1 至GLn-1时,所述定时控制器132分别将所述数据信号DATA1至DATA6 延迟所述预定的延迟时间tda,tdb,tdc,tdd和tde,并顺序地输出所述数据 信号DATA1至DATA6。
    如图8所描述,当所述第二栅极驱动器170驱动所述第二栅极线组GL2 至GLn时,所述定时控制器132分别将所述数据信号DATA6至DATA1延 迟所述预定的延迟时间tdf,tdg,tdh,tdi和tdj,并顺序地输出所述的数据 信号DATA6至DATA1。
    如上所述,所述数据信号DATA1至DATA6的输出顺序和延迟时间根据 所述栅极信号G1至Gn通过所述栅极线GL1至GLn的传送方向来设置,并 且因而通过所述栅极线GL1至GLn传送的所述栅极信号G1至Gn的延迟可 以得到补偿。
    图9为示出根据所述栅极信号通过所述第一栅极线组的延迟设置所述数 据信号的输出定时的方法的图。
    参照图2和9,当在所述显示装置100上布置的所述数据驱动电路的数 目是12时,所述定时控制器132在每个数据驱动电路#1至#12内,将所 述数据信号DATA1到DATA12的输出定时设定为互不相同。
    如图9所示,当所述第一栅极驱动器160驱动所述第一栅极线组GL1 至GLn-1时,在所述栅极信号Gi(i=1,3,...,n-1)的延迟时间随着所述栅 线从所述第一栅极驱动器160向远处延伸而增加。
    为了补偿所述栅极信号Gi的延迟时间,施加到所述数据驱动电路#1 至#12的所述数据信号DATA1到DATA12的输出定时,被设定为彼此不同。 所述定时控制器132基于从所述第一栅极驱动器160输出的所述栅极信号 Gi的所述延迟时间,延迟施加到所述数据驱动电路#1至#12的所述数据信 号DATA1到DATA12的输出定时。
    图10为示出根据所述栅极信号通过所述第二栅极线组的延迟,设置所 述数据信号的输出定时的方法的图。
    参照图2和10,当在所述显示装置100上布置的所述数据驱动电路的数 目是12时,所述定时控制器132在每个数据驱动电路#1至#12内,将所 述数据信号DATA1到DATA12的输出定时设定为互不相同。
    如图10所示,当所述第二栅极驱动器170驱动所述第二栅极线组GL2 至GLn时,所述栅极信号Gj(j=2,4,...,n)的延迟时间随着所述栅极线 从第二栅极驱动器170向远处延伸而增加。
    因此,施加到所述数据驱动电路#1至#12的所述数据信号DATA1到 DATA12的输出定时,为了补偿所述栅极信号Gj的延迟时间,被设定为彼 此不同。所述定时控制器132基于从所述第二栅极驱动器170输出的所述栅 极信号Gj的所述延迟时间,延迟施加到所述数据驱动电路#1至#12的所 述数据信号DATA1到DATA12的输出定时。
    图11为示出在图1中所示的所述显示面板内显示的图像的图。
    参照图2和11,尽管当所述第一栅极驱动器160驱动所述第一栅极线组 GL1至GLn-1时,具有相同的灰度级的所述数据驱动信号被施加到所述数据 线DL11至DL6K,相对远离所述第一栅极驱动器160形成的像素的充电速 率可低于邻近所述第一栅极驱动器160形成的像素的充电速率。在此情况下, 在对应于所述第一栅极线组GL1至GLn-1的所述显示面板110的奇数编号 的横行L1至Ln-1内,与所述数据线DL6K对应的位置处的亮度比与所述数 据线DL11对应的位置处的亮度低。
    类似地,尽管当所述第二栅极驱动器170驱动所述第二栅极线组GL2 至GLn时具有相同的灰度级的所述数据驱动信号被施加到所述数据线DL11 至DL6K,相对远离所述第二栅极驱动器170形成的各像素的充电速率依然 会低于邻近所述第二栅极驱动器170形成的像素的充电速率。在此情况下, 在对应于所述第二栅极线组GL2至GLn的所述显示面板110的偶数编号的 横行L2至Ln内,与所述数据线DL11对应的位置处的亮度比与所述数据线 DL6K对应的位置处的亮度低。
    由于该显示面板110的所述像素PX之间的充电速率的不同,横行图案 会出现在对应于所述栅极线GL1至GLn的所述显示面板110的横行L1至 Ln内。
    图12为示出补偿施加到图11中所示的所述显示面板的所述数据驱动信 号的示例的图。
    参照图2和12,当所述第一栅极驱动器160驱动所述第一栅极线组GL1 至GLn-1时,所述定时控制器132控制并输出所述数据信号DATA1至 DATA6,使得对于同样的图像RGB信号,施加于远离所述第一栅极驱动器 160放置的所述数据驱动电路146的所述数据驱动信号的灰度级电压电平, 相比与施加于邻近所述第一栅极驱动器160放置的所述数据驱动电路141的 所述数据驱动信号的灰度级电压电平,变得更高。图12中,当所述第一栅 极驱动器160驱动所述第一栅极线组GL1至GLn-1时,施加到所述数据线 DL11到DL6K的所述数据驱动信号将被表示为“奇数数据驱动信号”。
    当所述第二栅极驱动器170驱动所述第二栅极线组GL2至GLn时,所 述定时控制器132控制并输出所述数据信号DATA1至DATA6,使得对于同 样的图像RGB信号,施加于远离所述第二栅极驱动器170放置的所述数据 驱动电路141的所述数据驱动信号的灰度级电压电平,相比与施加于邻近所 述第二栅极驱动器170放置的所述数据驱动电路146的所述数据驱动信号的 灰度级电压电平,变得更高。
    图12中,当所述第二栅极驱动器170驱动所述第二栅极线组GL2至 GLn时,施加到所述数据线DL11到DL6K的所述数据驱动信号将被表示为 “偶数数据驱动信号”。
    所述定时控制器132将通过补偿所述图像RGB信号而得到的所述数据 信号DATA1到DATA6,分别施加到所述数据驱动电路141至146。当所述 第一栅极驱动器160驱动所述第一栅极线组GL1至GLn-1时,对于所述图 像RGB信号,与施加到所述数据驱动电路141的所述数据信号DATA1的补 偿量相比,所述定时控制器132更多地增加施加到所述数据驱动电路143和 146的所述数据信号DATA3和DATA6的补偿量。因此,在远离所述显示面 板110的所述第一栅极驱动器160的位置,所述亮度没有降低。
    类似地,当所述第二栅极驱动器170驱动所述第二栅极线组GL2至GLn 时,对于所述图像RGB信号,与施加到所述数据驱动电路146的所述数据 信号DATA6的补偿量相比,所述定时控制器132更多地增加施加到所述数 据驱动电路143和141的所述数据信号DATA3和DATA1的补偿量。因此, 在远离所述显示面板110的所述第二栅极驱动器170的位置,所述亮度没有 降低。
    如关于图7的描述,当所述第一栅极驱动器160驱动所述第一栅极线组 GL1至GLn-1时,所述定时控制器132,基于所述第一栅极驱动器160与所 述数据驱动电路141至146之间沿所述第一方向X1的距离,延迟分别施加 到所述数据驱动电路141至146的所述数据信号DATA1到DATA6的输出定 时。此外,所述定时控制器132,根据所述第一栅极驱动器160与所述数据 驱动电路141至146之间沿所述第一方向X1的距离,增加所述数据信号 DATA1到DATA6的所述补偿量。
    如关于图8的描述,当第二栅极驱动器170驱动所述第二栅极线组GL2 至GLn时,所述定时控制器132,基于所述第二栅极驱动器170与所述数据 驱动电路146至141之间沿所述第二方向X2的距离,延迟分别施加到所述 数据驱动电路146至141的所述数据信号DATA6到DATA1的输出定时。此 外,所述定时控制器132,根据所述第二栅极驱动器170与所述数据驱动电 路146至141之间沿所述第二方向X2的距离,增加所述数据信号DATA6 到DATA1的补偿量。
    也就是说,所述定时控制器132可执行,采用图7和8中所示的所述输 出定时延迟的所述亮度补偿方法或者采用图12中所示的所述灰度级补偿方 法的所述亮度补偿方法中的一个或两者。
    图13为示出补偿施加到图1中所示的所述显示面板的所述数据驱动信 号的另一示例的图。
    类似于图12中所示的所述亮度补偿方法,在图13中所示的所述亮度补 偿方法根据所述第一栅极驱动器160与所述数据驱动电路141至146之间沿 所述第一方向X1的距离以及所述第二栅极驱动器170与所述数据驱动电路 146至141之间沿所述第二方向X2的距离,改变关于所述数据信号DATA1 到DATA6的所述补偿量。
    参照图2和13,所述定时控制器132,基于所述数据驱动电路141至146 与所述像素PX之间沿所述第三方向X3的距离,增加所述数据信号DATA1 至DATA6的补偿量。
    在图13中,当所述第一栅极驱动器160驱动所述第一栅极线组GL1至 GLn-1时,施加到所述数据线DL11到DL6K的所述数据驱动信号被表示为 “奇数数据驱动信号”。另外,当所述第二栅极驱动器170驱动所述第二栅 极线组GL2至GLn时,施加到所述数据线DL11到DL6K的所述数据驱动 信号将被表示为“偶数数据驱动信号”。
    所述定时控制器132控制并输出数据信号DATA1到DATA6,使得施加 于沿所述第三方向X3相对远离所述数据驱动电路141至146放置的所述像 素PX的所述数据驱动信号的灰度级电压电平,相比于施加于沿所述第三方 向X3邻近所述数据驱动电路141至146形成的所述像素PX的所述数据驱 动信号的灰度级电压电平,变得更高。
    从所述数据驱动电路141至146输出的所述数据驱动信号通过所述数据 线DL11到DL6K施加到所述显示面板110的所述像素PX。所述数据驱动 信号根据所述数据驱动电路141至146与所述像素PX之间沿所述第三方向 X3的距离来延迟。由于对于所述数据信号DATA1到DATA6的补偿量根据 所述数据驱动电路141至146与所述像素PX之间沿所述第三方向X3的距 离而改变,所以在远离所述数据驱动电路141至146的位置,所述亮度可以 被补偿。
    也就是说,所述定时控制器132可执行,采用图7和8中所示的所述输 出定时延迟的所述亮度补偿方法或者采用图13中所示的所述灰度级补偿的 所述亮度补偿方法中的一个或两者。
    虽然已对本发明示例性的实施例进行了描述,但是应该理解的是,本发 明不应该局限于这些示例性实施例,相反,在以下声明的本发明精神和范围 内,本领域普通技术人员可作出各种不同的变化和修改。

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